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Mikrochips werden klassischerweise auf Silizium-Scheiben - den Wafern - prozessiert. Doch für einige Anwendungen sind die Wafer mittlerweile so dünn, dass Ihre Handhabung für viele Firmen zum Problem wird. Eine elegante Lösung für die Herstellung extrem dünner mikroelektronischer Komponenten, die Realisierung von verlustarmen Leistungselektronik-Bausteinen oder die Entwicklung von 3D-integrierten Chip-Aufbauten hat nun das Fraunhofer IZM entwickelt.
Mobile elektrostatische Träger für die Prozessierung ultradünner Wafer
Die Technik ist deshalb besonders interessant, weil durch sie auch dünnste Wafer im Dickenbereich von 20 - 50 µm in den vorhandenen Prozessanlagen der Halbleiterindustrie weiterprozessiert werden können. Dazu werden die gedünnten bzw. die zu dünnenden Produkt-Wafer auf einen spezifisch präparierten Träger-Wafer gelegt und anschließend durch Aufladen einer großflächigen Elektrodenstruktur elektrostatisch fixiert.
Es hat sich gezeigt, dass bei Auswahl einer geeigneten dielektrischen Beschichtung auf dem Träger-Substrat eine lang andauernde elektrische Polarisierung erzielt wird. Der dünne Wafer bleibt somit auch nach Abkopplung der Ladespannung sicher auf dem Träger fixiert und kann weitere Prozessschritte durchlaufen. Nach Beendigung der Fertigungssequenz wird die Elektrodenstruktur entladen, und der gedünnte Wafer kann leicht wieder entfernt werden.
Da für diese neue Trägertechnik keine polymeren Klebstoffe benötigt werden, sind nach dem Ablösen des zu bearbeitenden Wafers auch keine Reinigungsprozeduren erforderlich.
Das Trägersubstrat selbst ist ein Silizium-Wafer, der in Dünnfilmtechnik strukturiert und an der Kontaktfläche zum fixierten dünnen Wafer vollständig elektrisch isoliert ist. Die Kontaktstellen zum Aufladen der Elektroden können an der Vorder- oder Rückseite des Trägersubstrats realisiert werden.
Im Gegensatz zu anderen Trägermaterialien, wie z.B. Glas, Saphir oder Keramik, bietet Silizium die entscheidenden Vorteile einer sehr guten Wärmeleitfähigkeit und, im Falle der Handhabung von dünnen Silizium-Wafern, auch einen ideal angepassten Wärmeausdehnungskoeffizient.
Einsatzmöglichkeiten
Die elektrostatische Haltekraft ist auch bei Temperaturen über 400 °C noch aktiv. Somit bietet diese Trägertechnik erstmals die Möglichkeit, Prozessschritte an sehr dünnen Wafern bei hohen Temperaturen auszuführen. Beispiele hierfür sind das Legieren von Rückseitenmetallisierungen oder das Aufbringen und Plasma-Ätzen von dielektrischen Schichten.
Potenzielle Anwendungsgebiete der elektrostatischen Trägertechnik sind neben der Leistungselektronik auch opto-elektronische Produkte, Bumping-Prozesse an dünnen Wafern, die Herstellung noch dünnerer Solarzellensubstrate und viele weitere Technologiefelder, bei denen fragile Substrate prozessiert werden sollen.
Kontakt:
Fraunhofer-Institut für Zuverlässigkeit und Mikrointegration IZM
Institutsteil München
Hansastraße 27 d
80686 München
URL: www.izm.fraunhofer.de
Christof Landesberger
Tel.: 089/54759 295
Fax: 089/54759 100
Mail: christof.landesberger@izm-m.fraunhofer.de
http://www2.izm.fhg.de/Bilder/traeger.zip - Technologiebilder zum Download
http://www.izm-m.fhg.de/de/index/dieabteilungen3_n400001abteilungen_a/dieabteilu... - Informationen zum Thema
http://www.izm.fhg.de/news_events/news/index.jsp - Weitere Technologien im Überblick
Schema des elektrostatischen Trägers
Quelle: Fraunhofer IZM
Träger im Ofen bei 400 °C
Quelle: Fraunhofer IZM
Merkmale dieser Pressemitteilung:
Elektrotechnik, Energie, Maschinenbau, Werkstoffwissenschaften
überregional
Forschungs- / Wissenstransfer, Forschungsergebnisse
Deutsch
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